addition signとは 意味・読み方・使い方

In addition, the need to send sign information for some of the refinement coefficients can be eliminated.例文帳に追加

さらに、リファインメント係数のいくつかのものに対する符号情報を送る必要性をなくすことができる。 - 特許庁

The register reset section 44 monitors the sign bit of the input data and output data of addition object for every adders A1-A5.例文帳に追加

レジスタリセット部４４は、加算器Ａ１〜Ａ５ごとに、加算対象の入力データおよび出力データのサインビットを監視する。 - 特許庁

In addition, personal consumption started showing a sign of recovery and the retail sales rebounded in January 2010 and recorded positive growth after 12 months (see Figure 1-2-5-85).例文帳に追加

個人消費にも回復の動きが見られており、2010年1 月の小売売上高は12 か月ぶりにプラスに転じた（第1-2-5-85 図）。 - 経済産業省

When an addition block 30 adds the multiplication value w.xi to find an addition value yj, a normal random number generation block 40 generates random numbers following a normal distribution with the addition value yj set to a mean value and outputs code bit sign of the generated random numbers.例文帳に追加

この乗算値ｗ・ｘ_i を加算ブロック３０が加算して加算値ｙ_j を求めると、正規乱数生成ブロック４０は、加算値ｙ_j を平均値とする正規分布に従う乱数を生成し、当該生成した乱数の符号ビットｓｉｇｎを出力する。 - 特許庁

In addition, the external electrode 19 is provided at a position where the sign of output voltage in the internal electrode 18 to the common electrode 16 and the sign of output voltage in the external electrode 19 to the common electrode 16 are different from each other when the ultrasonic waves are detected.例文帳に追加

また、超音波を検出するときに、共通電極１６に対する内側電極１８における出力電圧の符号と、共通電極１６に対する外側電極１９における出力電圧の符号とが互いに異なるような位置に外側電極１９を設ける。 - 特許庁

A clip code is generated not by using the zero flag of addition/subtraction results and an addition/subtraction result sign, but by using the comparison results of the exponent and mantissa comparison parts found by the preprocessing, so the clip code can be generated fast without increasing the circuit scale.例文帳に追加

加減算結果による零フラグおよび加減算結果符号を用いてクリップコードを生成せず、前処理で求められる指数および仮数比較部の比較結果を用いて、クリップコードを生成するので、回路規模を増大させることなく、高速にクリップコードを生成することが可能である。 - 特許庁

In the subtraction-based calculation, when the last two figures of bits in a sign extension multiplier are 0, 1, subtraction for the multiplicand is performed, while when they are 0, 0, addition for the multiplicand is performed while shifting to the addition-based calculation.例文帳に追加

また、減算基調の演算では、符号拡張乗数におけるビットの数値が下桁側から順に０、１となる場合に被乗数に係る減算を行い、下桁側から順に０、０となる場合に加算基調の演算に移行しつつ被乗数に係る加算を行う。 - 特許庁

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